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연산보고서 1건 · 본문 13대목

지표 현황

2026-10-05 종가 기준 · 출처 Yahoo Finance
종가
$631.75
200일선 대비
+67.6%
200일선 $376.84
52주 위치
하단에서 97%
RSI(14)
69.2
52주 최저 $188.22최고 $645.46

지표 값만 적습니다. 매수·매도를 권유하지 않으며, 이 수치로 어떤 판단도 대신하지 않습니다. 하루 한 번 갱신되므로 실시간 시세와 다릅니다.

이 종목을 다룬 보고서

본문 언급

보고서 5건에서 13번 등장합니다. 보고서마다 최대 3대목까지 보여줍니다.

한국거래소(KRX) 상장
ETF명종목코드운용사순자산총보수환헤지기준일관련 편입
TIGER 미국AI반도체팹리스491830미래에셋자산운용2,150억 원 [추정]연 0.49%환노출2026-09-15MRVL 5.82%, AVGO 16.45%, NVDA 24.10%, QCOM 9.80%, AMD 9.15%
KODEX 미국반도체MV390390삼성자산운용1조 4,500억 원연 0.09%환노출2026-09-15AVGO 7.80%, MRVL 2.45%, NVDA 20.50%, TSM 13.20%, ALAB 편입 확인 (비중 미확인)
ACE 미국반도체포커스446770한국투자신탁운용3,250억 원 [추정]연 0.15%환노출2026-09-15AVGO 18.20%, NVDA 23.50%, AMD 17.80%, MRVL 편입 확인 (비중 미확인)
미국 상장
ETF명티커운용사순자산총보수기준일관련 편입
iShares Semiconductor ETFSOXXBlackRock162.8억 달러연 0.35%2026-09-15AVGO 8.15%, NVDA 7.95%, MRVL 3.82%, AMD 6.80%, QCOM 6.20%. ALAB 미편입
VanEck Semiconductor ETFSMHVanEck287.4억 달러연 0.35%2026-09-15NVDA 20.50%, TSM 13.20%, AVGO 7.80%, MRVL 2.45%, ALAB 편입 확인 (비중 미확인)
Invesco Semiconductors ETFPSIInvesco8.95억 달러연 0.57%2026-09-15MRVL 4.65%, AVGO 4.95%, ALAB 1.82%, ON 4.80%, ADI 4.75%
핵심 관찰 3개
  1. 분화는 대체가 아니라 분업의 형태로 일어났다. 범용 GPU는 어떤 모델이 돌아갈지 아직 정해지지 않은 워크로드를 맡고, 커스텀 ASIC은 고객이 이미 물량과 연산 형태를 아는 워크로드를 떼어 간다. Broadcom이 구글 TPU와 메타 MTIA에 이어 OpenAI·Anthropic의 맞춤형 가속기 개발 계약까지 확정한 것이 그 분업의 현재 모습이다.[^4]
  2. 분업이 진행될수록 설계사의 매출이 소수 고객에 묶인다. Broadcom은 빅테크 Custom ASIC 설계에서 200억 달러 이상의 매출을 올리는데,[^4][^5] 그 고객은 몇 곳뿐이다. Astera Labs는 아마존 Trainium2 인프라 공급과 함께 아마존과의 신주인수권 계약을 자본 구조에 안고 있다.[^16] 고객 집중은 매출뿐 아니라 계약 조건에도 남는다.
  3. 어느 경로를 택하든 통과해야 하는 공통 관문이 둘 있다. 하나는 랙 단위 인터커넥트다. NVLink는 1.8TB/s인 반면 AMD MI350X의 상호연결 대역폭은 약 128GB/s로 알려져 있다.[^5] 다른 하나는 설계 툴이다. 엔비디아든 브로드컴이든 AMD든 Synopsys와 Cadence의 EDA 없이는 칩을 물리적으로 설계할 수 없다.[^7]
아직 확인되지 않은 내용
  • ARM의 매출 성장 가이던스와 로열티 요율, Qualcomm의 현금흐름 지표, Astera Labs의 분기 실적, 빅테크 합산 CAPEX 총액은 근거 출처가 검토 시점에 접근 차단(HTTP 403·405) 상태였다. 값은 원문대로 유지했으나 재확인하지 못했다.
  • AMD의 2026년 Instinct 사업부 매출과 Synopsys의 연 매출 증가는 원문 자체가 추정·전망치로 제시한 값이다.
  • 컴퓨팅 이용 효율(MFU) 50~55% 대 약 45%라는 대비는 단일 출처에 근거하며, 어떤 모델을 어느 규모 클러스터에서 측정했는지가 공개되어 있지 않다.
기술·산업 구조
층하는 일갈라지는 기준이 층의 종목
범용 가속기모델과 물량이 아직 확정되지 않은 학습·추론유연성과 소프트웨어 성숙도NVDA, AMD
커스텀 ASIC고객이 물량과 연산 형태를 아는 워크로드단위 연산당 총소유비용AVGO, MRVL
공통 관문칩을 잇는 연결과 칩을 그리는 도구대체 가능성ALAB, SNPS, ARM
CPO의 실제 속도는 패키징과 파이버가 제한한다

CPO를 늦추는 것은 아이디어가 아니라 공정이다. 광 다이(SiPho 또는 InP)와 CMOS ASIC을 이종 집적하려면 서브마이크론 하이브리드 본딩 같은 선단 패키징이 필요하고, 용량·수율·비용이 모두 제약이다.[^5] TSMC의 COUPE는 2026년 2월 리스크 생산에 들어갔고, AMD와 공동 개발한 패키지당 6.4T 솔루션이 2026년 하반기 양산에 들어갈 것으로 예상된다.[^5]